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| LEADER |
01139nam a2200349 a 4500 |
| 001 |
000122859 |
| 005 |
20200615152627.0 |
| 008 |
110211s2007 xxu 000 0 spa d |
| 020 |
|
|
|a 1420051547
|
| 020 |
|
|
|a 9781420051544
|
| 040 |
|
|
|a Sistema de Bibliotecas del Tecnológico de Costa Rica
|
| 082 |
0 |
4 |
|a 004.21
|b C377v
|
| 100 |
1 |
|
|a Cavanagh, Joseph
|
| 245 |
1 |
0 |
|a Verilog HDL :
|b Digital Design and Modeling /
|c Joseph Cavanagh.
|
| 260 |
|
|
|a Boca Ratón :
|b CRC,
|c 2007.
|
| 300 |
|
|
|a 900 páginas :
|b tablas.
|
| 336 |
|
|
|a texto
|b txt
|2 rdacontenido
|
| 337 |
|
|
|a no mediado
|b n
|2 rdamedio
|
| 338 |
|
|
|a volumen
|b nc
|2 rdaportador
|
| 504 |
|
|
|a Bibliography
|
| 505 |
0 |
|
|a Índex
|
| 590 |
|
|
|a INGE
|
| 590 |
|
|
|a COMP
|
| 650 |
1 |
7 |
|a Verilog
|x Lenguaje para descripción de equipo de computación
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Circuitos integrados
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Diseño digital
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Lenguajes de programación
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Síntesis lógica
|2 Tesauro SIBITEC
|
| 655 |
|
4 |
|a libros
|
| 903 |
|
|
|a Rebeca
|b 2015/09/29
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| 904 |
|
|
|a M Oviedo
|b 2018/09/11
|
| 904 |
|
|
|a Maricela
|b 2020/06/15
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