|
|
|
|
| LEADER |
01398nam a2200361 u 4500 |
| 001 |
000274400 |
| 005 |
20240207142908.0 |
| 008 |
190308s2018 cr ||m ||| ||spa d |
| 040 |
|
|
|a Sistema de Bibliotecas del Tecnológico de Costa Rica
|
| 090 |
|
|
|a TF 8346
|
| 100 |
1 |
|
|a Rivera-Arrieta, Irene Beatriz
|
| 245 |
1 |
0 |
|a Creación de un ambiente de verificación usando UVM para un bus AXI4-Lite para una arquitectura RISC-V de 32 bits. /
|c Irene Beatriz Rivera-Arrieta.
|
| 260 |
|
|
|a Cartago, :
|b I. B. Rivera A.,
|c 2018.
|
| 300 |
|
|
|a 1 disco de computadora :
|b ilustraciones, diagramas, tablas.
|
| 336 |
|
|
|a texto
|b txt
|2 rdacontenido
|
| 337 |
|
|
|a computadora
|b c
|2 rdamedio
|
| 338 |
|
|
|a disco de computadora
|b cd
|2 rdaportador
|
| 502 |
|
|
|a Proyecto de graduación
|b (Licenciatura en Ingeniería Electrónica)
|c Instituto Tecnológico de Costa Rica, Escuela de Ingeniería Electrónica,
|d 2018.
|
| 504 |
|
|
|a Bibliografía
|
| 590 |
|
|
|a ITCR
|
| 590 |
|
|
|a COTA
|
| 590 |
|
|
|a CSUCA
|
| 590 |
|
|
|a ELEC
|
| 610 |
2 |
4 |
|a Instituto Tecnológico de Costa Rica
|
| 650 |
1 |
7 |
|a Modelo
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Programación
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Producto
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Ambiente
|2 Tesauro SIBITEC
|
| 650 |
1 |
7 |
|a Arquitectura
|2 Tesauro SIBITEC
|
| 651 |
|
4 |
|a Costa Rica
|z Cartago
|
| 655 |
|
4 |
|a Tesis
|
| 902 |
|
|
|a autécnica
|b 2019/03/18
|
| 904 |
|
|
|a Luis Fdo
|b 2024/02/07
|