Desarrollo de un ambiente de verificación para una unidad lógica aritmética mediante la metodología universal de verificación (UVM). /

Desarrollo de un ambiente de verificación para una unidad lógica aritmética mediante la metodología universal de verificación (UVM). /

Bibliographic Details
Main Author: Valenciano-Blanco, Pablo André
Format: Thesis Book
Language:Spanish
Published: Cartago, Costa Rica : P. A. Valenciano B., 2018.
Subjects:
Instituto Tecnológico de Costa Rica
Unidad central de proceso
Metodología
Verificación
Programas
Hardware
Costa Rica > Cartago
Tesis

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