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| LEADER |
01602nam a2200349 a 4500 |
| 001 |
000687205 |
| 005 |
20221207115613.0 |
| 008 |
221107s2020 cr d grm ||||||spa d |
| 040 |
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|a Sistema de Bibliotecas de la Universidad de Costa Rica
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| 099 |
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9 |
|a TFG 46814
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| 100 |
1 |
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|a Badilla Alvarado, Rafael Esteban
|d 1995-
|e Autor/a
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| 245 |
1 |
0 |
|a Diseño e implementación de un algoritmo de gestión de memoria para disminuir las Escrituras en una Memoria de Tecnología STT-RAM /
|c por Rafael Esteban Badilla Alvarado, Carlos Eduardo Solano Abarca, Heberth Gerard Valverde Gardela; Roberto Alonso Rodriguez Rodriguez, director.
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| 260 |
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|a San José, Costa Rica,
|c 2020.
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| 300 |
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|a xvi, 99 páginas, 50 páginas sin numerar :
|b gráficos a color.
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| 502 |
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|a Seminario de graduación (licenciatura en ingeniería eléctrica)--Universidad de Costa Rica. Facultad de Ingeniería. Escuela de Ingeniería Eléctrica, 2020.
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| 650 |
0 |
7 |
|a MEMORIA CACHE
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| 650 |
0 |
0 |
|a ELECTRONICA DIGITAL
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| 650 |
0 |
7 |
|a MAGNETISMO
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| 650 |
0 |
7 |
|a TRANSMISION DE POTENCIA
|
| 650 |
0 |
7 |
|a CONSUMO DE ENERGIA ELECTRICA
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| 650 |
0 |
7 |
|a ARQUITECTURA DE COMPUTADORA
|
| 650 |
0 |
0 |
|a ALGORITMOS
|x DISEÑO
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| 700 |
1 |
|
|a Solano Abarca, Carlos Eduardo
|d 1994-
|e Autor/a
|
| 700 |
1 |
|
|a Valverde Gardela, Heberth Gerard
|d 1995-
|e Autor/a
|
| 700 |
1 |
|
|a Rodríguez Rodríguez, Roberto Alonso
|d 1979-
|e Director/a del TFG
|
| 900 |
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|a 2022-O
|
| 904 |
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|
|a Escuela de Ingeniería Eléctrica
|
| 907 |
|
|
|a Facultad de Ingeniería
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| 919 |
|
|
|a Ingeniería
|
| 916 |
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|
|a Centro Catalográfico
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| 949 |
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|a AM-IAAM.
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| 921 |
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|a proyecto fin de carrera
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