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LEADER |
01015nmm a2200289 a 4500 |
001 |
000123410 |
005 |
20130429145830.0 |
008 |
110302s2010 cr d spa d |
040 |
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|a Sistema de Bibliotecas del Tecnológico de Costa Rica
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090 |
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|a TF 6765
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100 |
1 |
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|a González Rojas, José Daniel
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245 |
1 |
0 |
|a Verificación lógica de los modelos sintetizados para circuitos integrados. /
|c José Daniel González Rojas.
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260 |
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|a Cartago, Costa Rica :
|b J. González R.,
|c 2010.
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300 |
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|a 1 disco de computadora :
|b diagramas.
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502 |
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|a Proyecto de graduación (Licenciatura en Ingeniería en Electrónica) Instituto Tecnológico de Costa Rica, Escuela de Ingeniería en Electrónica, 2010
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504 |
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|a Bibliografía
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505 |
1 |
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|a Índice, apéndices
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590 |
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|a ITCR
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590 |
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|a CSUCA
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590 |
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|a COTA
|
590 |
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|a ELEC
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650 |
1 |
4 |
|a Circuitos integrados
|
650 |
1 |
4 |
|a Fallas lógicas
|
650 |
1 |
4 |
|a Rastreo
|
650 |
1 |
4 |
|a Verificación
|
655 |
|
4 |
|a Tesis
|
902 |
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|a JENRIQUEZ
|b 2013/04/26
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